Grundlegend optimierter Entwurf eines AES-Algorithmus in FPGA

Dieses Buch konzentriert sich hauptsächlich auf die Forschung im aktuellen Bereich der Netzwerksicherheitsalgorithmen und deren optimierten Entwurf im Bereich der Flächenoptimierung. Dieses Buch richtet sich an ein breites Spektrum von Lesern, die von einem Verständnis des AES-Algorithmus und seines Gesamtprozesses in Verbindung mit der VHDL-Softwareimplementierung auf Xilinx-FPGA-Bausteinen profitieren werden. Dazu gehören Studenten und Fachleute auf dem Gebiet der Datenverarbeitung und Datenkommunikation, Designer und Implementierer sowie Kunden und Manager im Bereich Datenkommunikation und Netzwerke. Dieses Buch ist so konzipiert, dass es für Leser mit wenig oder mehr Hintergrundwissen über kryptografische Algorithmen in sich abgeschlossen ist.

Autorentext

Prof. H.S.Deshpande, der als Assistenzprofessor am S.K.N.Sinhgad College of Engineering arbeitet, schloss sein ME(Electronics Engineering) mit einem Projekt ab, das auf der optimierten Implementierung von Netzwerksicherheitsalgorithmen in FPGA basiert. Die Optimierung erfolgte im Bereich der Reduzierung der Anzahl der Slices durch die bevorzugte Verwendung der statischen RAM-Struktur in FPGA CLBs.